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Este libro propone un sumador aproximado energéticamente eficiente que proporciona una suma de alto rendimiento y bajo consumo sin degradación severa de la calidad. El sumador propuesto introduce una lógica aproximada de área eficiente que se utiliza para sumar los bits menos significativos del sumador. El principal reto de la tecnología VLSI moderna es la eficiencia energética debido al aumento de la funcionalidad en un único chip. La eficiencia energética puede lograrse mediante el diseño de circuitos imprecisos para un dominio específico de aplicaciones conocidas como aplicaciones tolerantes a errores. Este trabajo propone una arquitectura sumadora energéticamente eficiente que consigue una enorme mejora tanto en el rendimiento de potencia como en el de velocidad.La eficacia del sumador propuesto se evalúa implementando la arquitectura de sumador propuesta y la existente en MATLAB para evaluar las métricas de error y en Tanner para evaluar las métricas de diseño. Los resultados de la simulación muestran que el sumador propuesto reduce significativamente la potencia, el área y el retardo simultáneamente con una pequeña pérdida de precisión.