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Este libro se centra principalmente en la investigación en el área reciente del algoritmo de seguridad de red y su diseño optimizado en el dominio de la optimización de área. Este libro está dirigido a una amplia gama de lectores que se beneficiarán de la comprensión del algoritmo AES y su proceso global asociado con la implementación de software VHDL en dispositivos FPGA Xilinx. Esto incluye a estudiantes y profesionales en el campo del procesamiento de datos y la comunicación de datos, diseñadores e implementadores y clientes y gestores de redes y comunicación de datos. Este libro está…mehr

Produktbeschreibung
Este libro se centra principalmente en la investigación en el área reciente del algoritmo de seguridad de red y su diseño optimizado en el dominio de la optimización de área. Este libro está dirigido a una amplia gama de lectores que se beneficiarán de la comprensión del algoritmo AES y su proceso global asociado con la implementación de software VHDL en dispositivos FPGA Xilinx. Esto incluye a estudiantes y profesionales en el campo del procesamiento de datos y la comunicación de datos, diseñadores e implementadores y clientes y gestores de redes y comunicación de datos. Este libro está diseñado para ser autocontenido, para lectores con poca o más experiencia en algoritmos criptográficos.
Autorenporträt
Prof. H.S.Deshpande, der als Assistenzprofessor am S.K.N.Sinhgad College of Engineering arbeitet, schloss sein ME(Electronics Engineering) mit einem Projekt ab, das auf der optimierten Implementierung von Netzwerksicherheitsalgorithmen in FPGA basiert. Die Optimierung erfolgte im Bereich der Reduzierung der Anzahl der Slices durch die bevorzugte Verwendung der statischen RAM-Struktur in FPGA CLBs.